ge Janac认为，尽管自动化软件工具和可重复使用的设计核心有所增长，人类设计工程师仍然必须完成大部分工作。

　　“更大更大的IC设计，如系统“芯片仍然需要越来越大的工程师团队，”InTime的创始人说，InTime已经筹集了550万美元的私人资金，用于推出企业工程管理软件，实时将人和设计数据联系在一起。 InTime的首批产品将于2000年下半年发布。

　　该行业的许多EDA工作都致力于改进特定工具并采用可重复使用的知识产权（IP）内核作为减少“设计差距”的方法 - 或者通过领先实现最大性能和集成的难度越来越大 - 工艺技术。Cadence设计系统公司高级设计系统部门的首席技术官Janac说：“整体推动更大，更快的设计专注于IP，但IP只占设计的三分之一。” HLDS的首席执行官在1996年被Cadence收购之前。

　　InTime战略的另一个关键方面是改进寄存器传输级（RTL）文件中的设计概念的实现，这些文件用于生成集成电路的物理布局。 “大多数设计真正从RTL最终确定开始，而且在游戏后期，”Janac争辩说。

　　为了解决RTL设计问题和工程管理，InTime计划提供“不仅有助于创建”的软件并且跟踪数据，但也预测性能和估计尚未完成的任务的结果，“Janac说。 InTime的软件将为管理人员提供对涉及许多工程师的设计项目的可视性，而无需接收来自参与开发的人员的电子邮件或消息。该系统还将允许工程师执行寄存器平衡，同时产品概念的RTL描述仍在不断发展。

　　InTime的工程企业管理软件（EEMS）由“数据智能桌面”系统组成，提供“自动驾驶”流程“用于整个开发周期中的用户输入和规范。管理人员可以通过“数据挖掘代理”查看进度，这些代理与工程数据相关联，可以在IC开发项目中实时解决问题。

　　“我们正在努力将所有内容整合在一起。”在我看来，EDA错过的一个原因是网络是关于协作和信息交换的，“Janac说。

　　Janac估计每年约有15,000个IC设计在全球约115,000名工程师耗资200亿美元。其中，自动设计管理包可能提供约10亿美元。 Janac表示，通过简化IC的设计，可以减少硅代工厂30亿美元的非重复工程（NRE）费用中的一部分。

　　然后存在设计缺口问题，其中微处理器的性能是是EDA制造的ASIC的10倍。工程师比其他产品设计的“手工制作”更高水平的微处理器正在达到1GHz的速度，但通常ASIC仍然在100到200MHz的频率范围内。 Janac认为这强调了工程师团队之间协作IC开发的必要性，以及前端设计的改进，例如创建更好的RTL文件。

　　InTime的概念最初将集中在IC和系统设计上，但是Janac表示，EEMS方法将适用于其他工程项目，如软件开发代理ip动态。

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　　，是指利用计算机辅助设计（CAD）软件，来完成超大规模集成电路（VLSI）芯片的功能设计、综合、验证、物理设计等流程的设计方式。